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Intel Corporation
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Sponsor für H1B-VisumBeratungFertigungLogistik
Intel Corporation entwickelt und fertigt Computertechnologien für den Einsatz in PCs, Rechenzentren, Cloud-Infrastrukturen, Edge-Systemen, Netzwerken und 5G-Umgebungen. Das Portfolio umfasst Intel-Core-, Xeon- und Atom-Prozessoren sowie diskrete Grafiklösungen, KI-Beschleuniger, Siliziumphotonik, eingebettete Lösungen und Technologien für Netzwerke und Speicher. Darüber hinaus unterstützt das Unternehmen Entwickler mit Softwaretools und technischen Ressourcen und konzentriert sich dabei auf Leistung, Sicherheit und die Weiterentwicklung KI-gestützter Computertechnologien.
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Stellen im Unternehmen

Pre-Silicon-Verifikationsingenieur für PLL/FLL-Takt-IP

Verifizieren Sie Intel-PLL- und FLL-Taktgenerator-IP vor der Fertigung und entwickeln Sie UVM-Testumgebungen und untersuchen Designprobleme. Leiten Sie die Mixed-Signal-Validierung und arbeiten Sie mit Designteams an der Weiterentwicklung der IP-Funktionen.

USVereinigte StaatenAZArizonaCAKalifornienMAMassachusettsOROregonTXTexas
122.440 $ – 172.860 $ / Jahr
HybridVollzeitMittlere StufeSeniorErforderliche Sprache: EnglischIngenieur
PerlPython

Beschreibung

  • SystemVerilog- und UVM-Testbenches, Verifikationsumgebungen und Tests erstellen.
  • PLL- und FLL-Taktgenerator-IP anhand von Mikroarchitekturspezifikationen verifizieren.
  • Verifikationsinfrastruktur und -methoden über mehrere IP-Generationen hinweg pflegen und verbessern.
  • Ursachen von Problemen vor der Fertigung in der Verifikationsumgebung untersuchen und ermitteln.
  • Testpläne verfassen und an technischen Reviews mit Designteams teilnehmen.
  • Mit Architekten, RTL-Entwicklern und Analogdesignteams zusammenarbeiten.
  • Die Mixed-Signal-Validierung einschließlich AMS-Simulationen und Schaltplan-Debugging leiten.
  • Probleme lösen, an denen mehrere Teams beteiligt sind.
  • Architektonische und mikroarchitektonische Funktionen für das IP-Design mitdefinieren und weiterentwickeln.

Anforderungen

  • Bachelorabschluss in Elektrotechnik, Computertechnik oder einem verwandten Fachgebiet mit mindestens 4 Jahren einschlägiger Berufserfahrung; alternativ Masterabschluss mit mindestens 3 Jahren oder Promotion mit mindestens 1 Jahr Berufserfahrung.
  • Mindestens 2 Jahre Erfahrung mit Methoden der Designverifikation und -validierung, einschließlich UVM, SystemVerilog und gängigen EDA-Tools.
  • Mindestens 2 Jahre Erfahrung mit Skriptsprachen wie Python und Perl.
  • Fortgeschrittene Kenntnisse im Schreiben und Debuggen von SystemVerilog-UVM-Code.
  • Vertrautheit mit PLL/FLL oder SoC-Taktung und der zugehörigen RTL-Entwicklung.
  • Fähigkeit zur teamübergreifenden Zusammenarbeit mit Architekten, RTL-Entwicklern und Analogdesignteams.
  • Sorgfältige Dokumentation von Testplänen und Debugging von Problemen vor der Fertigung.
  • Ausgeprägte Fähigkeiten zur proaktiven Problemlösung und Ursachenanalyse.

Zusatzleistungen

  • Wettbewerbsfähige Vergütung.
  • Aktienboni.
  • Gesundheitsleistungen.
  • Leistungen zur Altersvorsorge.
  • Urlaubsleistungen.
  • Hybrides Arbeitsmodell mit einer Aufteilung der Arbeitszeit zwischen Büro und mobilem Arbeiten.

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