Intel Corporation
Intel Corporation
Intel Corporation desarrolla y fabrica tecnologías informáticas utilizadas en ordenadores personales, centros de datos, infraestructuras en la nube, sistemas periféricos, redes y entornos 5G. Su cartera incluye los procesadores Intel Core, Xeon y Atom, además de gráficos discretos, aceleradores de inteligencia artificial, fotónica de silicio, soluciones integradas y tecnologías de redes y almacenamiento. La empresa también apoya a los desarrolladores mediante herramientas de software y recursos técnicos, con especial atención al rendimiento, la seguridad y el avance de la informática basada en inteligencia artificial.

Ingeniero/a de verificación pre-silicio de IP de reloj PLL/FLL

Verifica IP de generadores de reloj PLL y FLL de Intel antes de la fabricación del silicio, desarrollando entornos de prueba UVM e investigando problemas de diseño. Lidera la validación de señales mixtas y colabora con los equipos de diseño para perfeccionar las funciones de la IP.

Descripción

  • Desarrollar bancos de prueba, entornos de verificación y pruebas con SystemVerilog y UVM.
  • Verificar la IP de generadores de reloj PLL y FLL frente a las especificaciones de microarquitectura.
  • Mantener y mejorar la infraestructura y los métodos de verificación en distintas generaciones de IP.
  • Investigar e identificar las causas raíz de problemas pre-silicio en el entorno de verificación.
  • Redactar planes de prueba y participar en revisiones técnicas con los equipos de diseño.
  • Colaborar con arquitectos, desarrolladores de RTL y equipos de diseño analógico.
  • Liderar la validación de señales mixtas, incluidas las simulaciones AMS y la depuración de esquemas.
  • Resolver problemas que involucren a varios equipos.
  • Contribuir a definir y perfeccionar las funciones arquitectónicas y microarquitectónicas del diseño de IP.

Requisitos

  • Licenciatura en Ingeniería Eléctrica, Ingeniería Informática o un campo relacionado, con al menos 4 años de experiencia pertinente; o máster con al menos 3 años; o doctorado con al menos 1 año.
  • Al menos 2 años de experiencia con métodos de verificación y validación de diseños, incluidos UVM, SystemVerilog y herramientas EDA estándar.
  • Al menos 2 años de experiencia con lenguajes de scripting como Python y Perl.
  • Dominio avanzado de la escritura y depuración de código UVM en SystemVerilog.
  • Familiaridad con PLL/FLL o la generación de reloj de SoC y el desarrollo de RTL relacionado.
  • Capacidad para colaborar entre equipos con arquitectos, desarrolladores de RTL y equipos de diseño analógico.
  • Documentación minuciosa de planes de prueba y depuración de problemas pre-silicio.
  • Iniciativa para resolver problemas y capacidad de análisis de causas raíz.

Beneficios

  • Remuneración competitiva.
  • Bonificaciones en acciones.
  • Prestaciones de salud.
  • Prestaciones de jubilación.
  • Vacaciones.
  • Modalidad de trabajo híbrida, con tiempo repartido entre el trabajo presencial y a distancia.

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