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Weekday (YC W21)
Weekday (YC W21)
11 – 50 Funcionários
ConsultoriaSaaSTecnologia de RH
A Weekday (YC W21) é uma plataforma de recrutamento focada na Índia, inserida nos setores de tecnologia de recursos humanos e software como serviço (SaaS). Ela combina ferramentas baseadas em inteligência artificial com um amplo banco de dados de candidatos para ajudar as empresas a identificar e entrar em contato com talentos por meio de uma abordagem proativa. A plataforma permite a comunicação por e-mail, WhatsApp e telefone, além de oferecer aos candidatos uma maneira simples de descobrir e se candidatar a vagas.
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Vagas da empresa

Engenheiro(a) de FPGA, projeto de chips (remoto, Índia)

Criar avaliações de projeto de chips e RTL de referência para sistemas de IA, analisando verificação, temporização, síntese e PPA em fluxos de trabalho de semicondutores. Esta vaga remota fica na Índia.

INÍndia
₹ 1.200.000 – ₹ 2.000.000 / ano
RemotoTempo integralPlenoSêniorIdioma Obrigatório: inglêsEngenheiro de hardware
PerlPython

Descrição

  • Criar avaliações práticas que abranjam projeto RTL, verificação, síntese, projeto físico e sign-off.
  • Desenvolver projetos de referência em Verilog, SystemVerilog ou VHDL, com testbenches, restrições e resultados esperados.
  • Definir critérios de avaliação e métodos de validação alinhados às práticas profissionais de engenharia.
  • Inspecionar RTL, testbenches, projetos de hardware e resultados de implementação produzidos por IA para identificar falhas funcionais e problemas de projeto.
  • Investigar falhas de verificação, lacunas de cobertura, violações de temporização e escolhas ineficientes de potência, desempenho e área.
  • Avaliar os projetos quanto à correção, conformidade de temporização, uso de recursos e qualidade da implementação.
  • Configurar e manter ambientes EDA nos quais agentes de IA possam executar fluxos realistas de projeto de chips.
  • Usar ferramentas relevantes, como Synopsys, Cadence, Siemens, AMD/Xilinx Vivado e Intel Quartus.
  • Criar avaliações de qualidade de síntese, resultados de place-and-route, análise estática de temporização e fechamento de temporização.
  • Transformar erros recorrentes dos agentes de IA em novos casos de avaliação e tarefas de engenharia progressivamente mais desafiadoras.
  • Trabalhar com equipes de engenharia e pesquisa para aprimorar ambientes de avaliação, métodos de teste e benchmarks técnicos.
  • Automatizar fluxos de projeto, testes e análise de resultados com linguagens de script.
  • Registrar soluções de referência, premissas de projeto, casos de falha e métodos de avaliação.

Requisitos

  • Ter de 3 a 5 anos de experiência prática em projeto ASIC ou FPGA, idealmente abrangendo várias etapas do fluxo de projeto digital.
  • Ter graduação B.E. ou B.Tech, ou mestrado M.Tech, em Engenharia Elétrica, Engenharia Eletrônica, VLSI ou área relacionada.
  • Ter sólidos conhecimentos de RTL em Verilog, SystemVerilog ou VHDL.
  • Ter experiência prática em verificação de projetos, incluindo desenvolvimento de testbenches, depuração, análise de cobertura e UVM ou métodos semelhantes.
  • Conhecer ferramentas e fluxos de trabalho EDA da Synopsys, Cadence, Siemens, AMD/Xilinx ou Intel.
  • Entender síntese lógica, place-and-route, análise estática de temporização, restrições de temporização e fechamento de temporização.
  • Aplicar bom discernimento de engenharia nas compensações entre potência, desempenho e área (PPA).
  • Ter conduzido pelo menos um projeto da especificação à implementação ou ao tape-out.
  • Ter fortes habilidades de depuração, análise e resolução de problemas, além de explicar com clareza por que um projeto é aprovado ou reprovado.
  • Experiência com Python, Tcl ou Perl para automação de fluxos de projeto é um diferencial.
  • Familiaridade com ferramentas de código aberto, como Yosys, OpenROAD, Verilator ou cocotb, é desejável.
  • Interesse em avaliações de engenharia de IA, ambientes de aprendizado por reforço ou pós-treinamento de modelos é bem-vindo, mas não obrigatório.

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