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Normal Computing
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51 – 200 Empleados
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Empleos de la empresa

Ingeniero de hardware FPGA

Da vida a diseños ASIC inspirados en la física para IA e infraestructura de semiconductores, y hazte cargo de la implementación RTL, la validación PCIe, los prototipos FPGA y la puesta en marcha del silicio.

USEstados UnidosCACaliforniaNYNueva York
250.000 $ – 340.000 $ / año
HíbridoTiempo completoIntermedioSeniorIdioma Obligatorio: inglésIngeniero de hardware
C++DockerPython

Descripción

  • Lidera la selección, adquisición y puesta en marcha de plataformas de prototipado FPGA para validar RTL antes del silicio y desarrollar software.
  • Adapta RTL de ASIC complejos a plataformas FPGA, incluidas arquitecturas con varios relojes, puentes CDC y cierre de temporización en diseños densos.
  • Integra diseños internos con IP de terceros y de proveedores.
  • Orienta el uso del ecosistema AMD/Xilinx, incluidos Vivado IP Integrator, transceptores y controladores de memoria.
  • Diseña, implementa y valida E/S de alta velocidad, especialmente PCIe para tarjetas aceleradoras en servidores estándar.
  • Desarrolla diseños de prueba basados en FPGA para la puesta en marcha del silicio, la caracterización de dispositivos y entornos de prueba automatizados.
  • Desarrolla software de abstracción de hardware en Python y C++, generación de mapas de registros y flujos automatizados de compilación y regresión.
  • Diagnostica problemas de temporización y funcionamiento en el laboratorio con ILA/Vivado Analyzer, osciloscopios, analizadores lógicos y caracterización de BER y diagramas de ojo.
  • Colabora a diario con los equipos de silicio, EDA e investigación durante todo el ciclo de vida de FPGA.

Requisitos

  • Experiencia profesional demostrable llevando diseños FPGA desde RTL hasta el cierre de temporización y la validación en hardware.
  • Conocimientos expertos de SystemVerilog o VHDL para síntesis.
  • Gran dominio de Xilinx Vivado, incluidos síntesis, emplazamiento y enrutamiento, cierre de temporización y catálogo de IP.
  • Experiencia práctica implementando y depurando PCIe, AXI/AHB, SPI, UART, JTAG y otras interfaces habituales.
  • Sólidas habilidades en Python para automatización, pruebas y herramientas de compilación.
  • Experiencia en puesta en marcha a nivel de placa y depuración práctica en laboratorio.
  • Capacidad para trabajar de forma autónoma, adaptarse rápidamente y resolver problemas ambiguos en hardware, software y física.
  • Se valorará experiencia con marcos de verificación como Cocotb o UVM.
  • Se valorará experiencia desplegando modelos de aprendizaje automático en FPGA o creando flujos de procesamiento de señales en tiempo real de menos de un microsegundo.
  • Se valorará experiencia con ASIC de señal mixta.
  • Se valorarán conocimientos de ajuste de SERDES y fundamentos de integridad de señal.
  • Se valorará experiencia con CI/CD de hardware mediante GitLab CI y flujos de compilación y prueba basados en Docker.

Beneficios

  • Participación accionaria.
  • Empresa que ofrece igualdad de oportunidades y está comprometida con la diversidad y la inclusión.
  • Adaptaciones razonables para personas con discapacidad.

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Desarrolla hardware de redes de alta velocidad de próxima generación en Cisco mediante el diseño, la simulación y la validación de encapsulados e interconexiones ASIC. Enfócate en la integridad de señal y potencia en tecnologías avanzadas de encapsulado.

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