AccelerComm Ltd
AccelerComm Ltd
AccelerComm Ltd développe des technologies de communication haute performance pour les réseaux 5G. Ses algorithmes de communication brevetés et sa propriété intellectuelle de la couche physique sont conçus pour les réseaux d’accès radio et aident les opérateurs, les fabricants d’équipements et les fournisseurs de composants électroniques à relever les défis liés à la capacité des réseaux, à la latence, à la consommation d’énergie et à l’efficacité spectrale. L’entreprise exerce ses activités dans les secteurs des télécommunications, de la fabrication et du conseil, et contribue à la collaboration au sein du secteur en participant à l’O-RAN ALLIANCE.

Responsable senior de l’équipe de conception – Systèmes satellitaires 5G ASIC/FPGA

Pilotez le développement d’IP de couche 1 pour ASIC et FPGA dédiées aux communications satellitaires 5G et non terrestres à faible consommation chez AccelerComm. Dirigez les équipes d’ingénierie, les livraisons clients et la planification technique transverse.

Description

  • Contribuer aux stations de base satellitaires 5G et aux technologies de communication non terrestres
  • Définir la feuille de route technique visant à améliorer l’efficacité énergétique de la prochaine génération de dispositifs qualifiés pour l’espace
  • Livrer aux clients les technologies développées
  • Soutenir les décisions techniques et la planification à l’échelle de l’entreprise avec les équipes Algorithmes, Architecture système et Logiciels
  • Fournir une orientation technique afin de garantir la réussite et le respect des délais des projets
  • Diriger l’équipe tout en développant l’expertise collective et en favorisant la progression individuelle
  • Transformer les exigences produit en livrables matériels avec les ingénieurs hardware seniors
  • Participer aux échanges avec les clients lors des phases d’avant-vente et de développement produit
  • Superviser l’implémentation FPGA et ASIC selon les méthodes standard du secteur, notamment le développement d’environnements de test basés sur UVM
  • Faire progresser les méthodes, processus et pratiques de conception et d’ingénierie, en intégrant l’IA lorsque cela est utile
  • Encadrer, accompagner et fournir régulièrement des retours aux membres de l’équipe

Exigences

  • Réussite démontrée dans la constitution et la direction d’équipes collaboratives et performantes
  • Expertise en conception RTL avec Verilog et SystemVerilog pour des produits ASIC et FPGA complexes
  • Solide expérience dans la livraison de conceptions numériques pour des plateformes ASIC et FPGA
  • Expérience dans l’optimisation du timing et des ressources matérielles pour des applications de traitement de données ou de signaux à haut débit
  • Expérience des techniques de gestion de l’alimentation, de la synthèse et de l’analyse temporelle
  • Maîtrise avancée des outils EDA de simulation et de synthèse
  • Connaissance des méthodes de gestion de projet utilisées tout au long du cycle de conception, notamment les approches agiles et en cascade
  • Connaissance des pratiques de recueil et de traçabilité des exigences
  • Connaissance des algorithmes de traitement des signaux de communication, notamment la correction d’erreurs, l’égalisation, l’estimation de canal et la formation de faisceaux
  • Compréhension des techniques de vérification UVM ou expérience pratique de l’application d’UVM à la vérification d’IP
  • Expérience des interfaces haut débit sur puce et hors puce telles qu’AMBA, PCIe ou JESD
  • Compréhension de C++ et SystemC pour la modélisation et l’intégration de conceptions
  • Expérience des modèles de maturité technologique
  • Compréhension de l’architecture système au sein d’une équipe projet pluridisciplinaire

Avantages

  • Rémunération définie en fonction des compétences et de l’expérience
  • Prime annuelle de performance pouvant atteindre 20 % du salaire
  • Attributions périodiques d’options d’achat d’actions EMI
  • Retraite
  • Assurance santé privée
  • Horaires de travail flexibles
  • Travail hybride

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