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Speicherarchitekt

Setze bei Normal Computing Thermo-In-Memory-Computing-Konzepte für KI-Inferenz in Silizium um. Entwirf Speicherarchitekturen, Schnittstellen und Modelle und bringe Testchips bis zum Tape-out.

USVereinigte StaatenCAKalifornienHybridVollzeitMittlere StufeSeniorErforderliche Sprache: EnglischArchitekt
C++Python

Beschreibung

  • Setze Thermo-In-Memory-Computing-Konzepte von der Theorie in Silizium um.
  • Gestalte Speicherzugriffspfade, Array-Organisation und Mikroarchitektur neu, damit Speicheroperationen mit leistungsstarkem Computing zusammenspielen.
  • Strebe eine 100- bis 1000-fache Verbesserung der Leistung bei der KI-Inferenz an.
  • Berichte an die Leitung des Silizium-Engineerings.
  • Arbeite mit Wissenschaftlerinnen und Wissenschaftlern, Mikroarchitektinnen und Mikroarchitekten sowie Fachleuten für physisches und analoges Design zusammen.
  • Entwickle eine Standardzellenbibliothek, die digitale Rechenprimitive mit ThermoDRAM-Rechenprimitiven kombiniert.
  • Überführe Rechenprimitive in ein leistungsstarkes Compute-in-Memory-System.
  • Steuere technische Beziehungen zu großen Herstellern – von der Beschaffung von PDKs bis zum Tape-out von Testchips und zur Produktion von Silizium.
  • Lege die Processing-in-Memory-Architektur, Speicheranforderungen, Floorplans, Lese- und Schreibschaltungen sowie Zeilen- und Spaltendekoder fest.
  • Entwirf lokale und globale Datenpfade, segmentierte Busse und On-Die-Netzwerke.
  • Verantworte Stromverteilung und Leistungsbudgets, thermische Grenzwerte, Redundanz, ECC, Datenhaltung und Ausbeute.
  • Steuere den Zugang zu PDKs und Fertigungsstätten, die Bewertung von Designregeln, die Planung von Shuttle-Tape-outs, Testchip-Inhalte, Zeitpläne und die Inbetriebnahme.
  • Arbeite mit Analogtechnik-Teams an Bibliotheken für primitive Bauelemente und lege Anforderungen an die Architekturleistung fest.
  • Definiere kundenspezifische Speicherschnittstellen, darunter SERDES-, PCIe-, Ethernet-, DDR5-, LP6- oder HBM-Klassen-Schnittstellen.
  • Überwache SPICE-, analytische und taktebenenbasierte Modelle für Leistung, Energieverbrauch und Ausbeute.
  • Arbeite mit Performance- und Machine-Learning-Teams zusammen, um Verbesserungen auf Workload-Ebene zu validieren.

Anforderungen

  • Umfangreiche Erfahrung mit Speicherarchitektur oder Schaltungsdesign bei einem Speicherhersteller oder einem auf speicherorientiertes Computing spezialisierten Unternehmen.
  • Fundierte Kenntnisse von 1T-, 3T-, 6T- und 8T-SRAM-Zellen, DRAM-Bitzellen, Kapazität, Leseverstärkung, Lese- und Schreibvorgängen, Kerntiming, Datenhaltung und Zuverlässigkeit.
  • Praktische Erfahrung mit Embedded Memory oder RAM-Technologien und PDKs.
  • Erfahrung mit der Entwicklung von Speicher-Testchips bis zum Tape-out.
  • Fähigkeit, das Schaltungsverhalten auf SPICE-Ebene mit Leistungs- und Energiemodellen auf Architekturebene zu verknüpfen.
  • Solide Programmierkenntnisse in Python, C, C++ oder einer anderen Sprache für Modellierung und Leistungsvorhersagen.
  • Erfahrung mit RTL und SystemVerilog.
  • Erfahrung mit Speicherschnittstellentypen.
  • Ausgezeichnete schriftliche und mündliche Kommunikationsfähigkeiten.

Zusatzleistungen

  • Das Unternehmen ist ein Arbeitgeber, der Chancengleichheit fördert und sich für Vielfalt und Inklusion einsetzt.
  • Für Menschen mit Behinderungen sind angemessene Vorkehrungen verfügbar.
  • Für personenbezogene Daten im Zusammenhang mit Bewerbungen gelten Datenschutzbestimmungen.

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