GlobalFoundries
GlobalFoundries
GlobalFoundries est un fabricant de semi-conducteurs qui sert des marchés à forte croissance grâce à ses technologies de procédés, son accompagnement en conception de puces, ses activités de développement et ses services de fabrication. Son travail associe ingénierie et production au sein d’une main-d’œuvre vaste et diversifiée, avec une présence industrielle répartie aux États-Unis, en Europe et en Asie. Pour les personnes à la recherche d’un emploi, GlobalFoundries propose des opportunités liées aux technologies des semi-conducteurs, à la fabrication de matériel, au développement de procédés et à la fabrication avancée.

Ingénieur en habilitation de conception de PDK quantique, vérification physique

Développer et maintenir des decks de règles DRC, LVS et PEX ainsi que des composants de PDK pour la fabrication de semi-conducteurs de GlobalFoundries. Améliorer la vérification physique grâce à l’automatisation, aux tests et à l’habilitation de conception assistée par IA/ML.

Description

  • Construire, qualifier et maintenir des decks de règles DRC, LVS et PEX ainsi que les composants de PDK associés.
  • Convertir les exigences d’intégration des procédés, les règles de conception, les définitions de dispositifs et les modèles électriques en solutions de vérification et d’extraction prêtes pour la production.
  • Créer des méthodes de régression et de test évaluant la conformité, la couverture, les performances, l’évolutivité et la compatibilité des decks de règles entre différentes technologies et différents environnements EDA.
  • Analyser des problèmes complexes de DRC, LVS et PEX, en déterminer les causes profondes et résoudre les écarts avec les équipes procédés, modélisation, conception et EDA.
  • Collaborer avec des spécialistes de la technologie des procédés, des règles de conception, de la modélisation compacte, de la fiabilité, de la conception de circuits, du layout et de l’EDA.
  • Développer des approches d’automatisation et des méthodes assistées par IA/ML pour la création de decks de règles, la génération de tests, l’analyse de couverture, la classification des erreurs, la détection d’anomalies, le débogage et l’assurance qualité des PDK.
  • Améliorer les flux de vérification et d’extraction en matière de précision, de temps d’exécution, d’efficacité mémoire, d’évolutivité, d’ergonomie et de déploiement en production.
  • Renforcer la qualité des PDK et leur préparation à la mise en production grâce à la qualification, aux tests de régression, à la documentation, au contrôle des changements et à l’amélioration continue.
  • Effectuer le travail en toute sécurité et contribuer aux initiatives relatives à l’environnement, à la santé, à la sécurité et à la sûreté.
  • Soutenir d’autres projets et missions selon les besoins.
  • Encadrer le personnel junior, diriger des projets de moyenne à grande envergure et contribuer à des équipes transversales réparties sur plusieurs sites.
  • Fournir des conseils techniques spécialisés et contribuer à des programmes externes, à des initiatives de fournisseurs, à des revues de consortiums, à des comités de conférences, à des brevets et à des publications.

Exigences

  • Diplôme de licence en génie électrique, génie informatique, microélectronique, informatique, physique appliquée ou discipline technique connexe.
  • Expérience pertinente en développement de PDK pour semi-conducteurs, vérification physique, EDA, conception physique de circuits intégrés, extraction des parasites ou domaine connexe, avec des exigences d’expérience définies selon le niveau de carrière GF concerné.
  • Expérience du développement, du codage, du débogage ou de la qualification de règles DRC et/ou LVS.
  • Connaissance de l’extraction des résistances et capacités parasites, de la modélisation des interconnexions, des effets dépendant du layout et de leur influence sur les performances des circuits.
  • Bonne connaissance pratique des technologies de procédé CMOS, des dispositifs semi-conducteurs, des règles de layout, des structures d’interconnexion et des relations entre conception et fabrication.
  • Expérience des environnements de vérification physique ou d’extraction standards du secteur et des pratiques de développement de decks de règles.
  • Maîtrise de Python, Tcl, Perl, des scripts shell ou d’outils équivalents pour l’automatisation de l’ingénierie, les tests de régression et l’analyse de données.
  • Capacité à diagnostiquer des problèmes techniques complexes, à mener une analyse structurée des causes profondes et à transformer les résultats en solutions d’ingénierie durables.
  • Disponibilité pour voyager jusqu’à 10 %.
  • Anglais courant à l’écrit comme à l’oral.
  • Licence avec 6 à 7 ans d’expérience, master avec 5 à 6 ans ou doctorat avec 3 à 4 ans.
  • Atout : diplôme de master ou de doctorat.
  • Atout : expérience du développement et de la mise en production de decks de règles DRC, LVS et/ou PEX de PDK de production.
  • Atout : expérience de Siemens Calibre, Synopsys IC Validator, Cadence Pegasus/PVS ou d’outils comparables.
  • Atout : expérience de la création de fichiers technologiques PEX, de l’extraction RC, de la modélisation des coins de procédé et de la corrélation des modèles avec le silicium.
  • Atout : expérience de la création d’environnements de régression automatisés, de métriques de couverture des règles, de structures de test ou de méthodes de qualification de PDK.
  • Atout : expérience de l’application de l’IA/ML, de l’IA générative ou de méthodes fondées sur les données à l’habilitation de conception des semi-conducteurs.
  • Atout : compréhension des relations entre l’intégration des procédés, les règles de conception, l’OPC/la lithographie, la modélisation des dispositifs, la fiabilité, l’extraction et la conception de circuits.
  • Atout : expérience du travail avec des fournisseurs EDA et des équipes de conception internes ou externes.
  • Atout : excellentes aptitudes à la communication écrite et orale.
  • Atout : solides capacités de planification et d’organisation.

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