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Sponsor de visa H1BIndustrie manufacturièreMatériel informatique
GlobalFoundries est un fabricant de semi-conducteurs qui sert des marchés à forte croissance grâce à ses technologies de procédés, son accompagnement en conception de puces, ses activités de développement et ses services de fabrication. Son travail associe ingénierie et production au sein d’une main-d’œuvre vaste et diversifiée, avec une présence industrielle répartie aux États-Unis, en Europe et en Asie. Pour les personnes à la recherche d’un emploi, GlobalFoundries propose des opportunités liées aux technologies des semi-conducteurs, à la fabrication de matériel, au développement de procédés et à la fabrication avancée.
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Offres de l’entreprise

Concepteur senior de circuits intégrés analogiques CryoCMOS – Quantum chez GlobalFoundries, sur site à Austin

Concevez et validez des circuits CMOS cryogéniques et mixtes pour des systèmes quantiques chez GlobalFoundries. Pilotez les travaux de l’architecture et de la simulation des circuits jusqu’au tapeout, à la caractérisation du silicium et à la corrélation avec les mesures.

USÉtats-UnisCACalifornieTXTexas
85 000 $ – 202 000 $ / an
Sur siteTemps pleinIntermédiaireSeniorLangue Requise : anglaisDesigner

Description

  • Créer des circuits CMOS analogiques et mixtes haute performance ainsi que de la propriété intellectuelle réutilisable.
  • Gérer le développement des circuits, de l’architecture et de la conception au niveau transistor jusqu’à la simulation, à la supervision du layout, à la vérification physique, au tapeout, à la caractérisation du silicium et à la corrélation entre la conception et les mesures.
  • Analyser les circuits dans différentes conditions de procédé, de tension et de température à l’aide d’analyses de Monte Carlo et de mismatch, d’études de bruit et de stabilité, de vérifications de linéarité et de synchronisation, ainsi que de simulations des parasites post-layout.
  • Améliorer les performances des circuits à différentes températures de fonctionnement, y compris dans des conditions cryogéniques, en tenant compte des limites de puissance, des variations de procédé, du comportement des dispositifs et des effets dépendant du layout.
  • Collaborer avec les équipes de modélisation des dispositifs et de PDK afin d’améliorer la précision des modèles, de combler les lacunes des règles de conception et de développer des PDK cryogéniques et avancés.
  • Définir les exigences de layout analogique et mener des revues portant sur le matching, le blindage, l’isolation, le contrôle des parasites, l’intégrité du signal, l’intégrité de l’alimentation et la fabricabilité.
  • Définir les structures de test du silicium et les plans de caractérisation, évaluer les données mesurées, résoudre les problèmes de performance et corréler les résultats matériels avec les simulations pré-silicium et les modèles compacts.
  • Piloter les revues techniques de conception, documenter les méthodes et les résultats, encadrer les ingénieurs et travailler avec des collaborateurs internes et externes.
  • Effectuer le travail en toute sécurité et soutenir les exigences et programmes relatifs à l’environnement, à la santé, à la sécurité et à la sûreté.

Exigences

  • Diplôme de licence en génie électrique, microélectronique, informatique, physique appliquée ou dans une discipline connexe.
  • Au moins cinq ans d’expérience pertinente en conception de circuits intégrés analogiques ou mixtes.
  • Expérience de la mise en œuvre de circuits analogiques ou mixtes, depuis la conception schématique, la simulation, le layout, la vérification DRC/LVS et l’extraction des parasites jusqu’au tapeout et à la validation du silicium.
  • Maîtrise des principes de conception CMOS analogique, notamment la physique des dispositifs, le bruit, le matching, la rétroaction, la stabilité, la réponse en fréquence, les variations de procédé et l’analyse PVT/Monte Carlo.
  • Maîtrise des outils et environnements standards du secteur pour la conception de circuits intégrés analogiques, la simulation SPICE, le layout, la vérification physique et l’extraction post-layout.
  • Capacité à analyser de manière autonome des problèmes complexes liés aux circuits et aux performances du silicium et à transformer les conclusions en améliorations de conception.
  • Disponibilité pour voyager jusqu’à 10 %.
  • Maîtrise de l’anglais écrit et parlé.

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